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▶ 8 位 CPU 内核
△ 精简指令集, 8 级深度硬件堆栈
△ CPU 为双时钟, 可在系统高/低频时钟之间切换
△ 高频时钟下 FCPU 可配置为 2T/4T/8T/16T/32T/64T,低频时钟下 FCPU 固定为 2T
▶ 程序存储器
△ 4K×16 位 FLASH 型程序存储器
△ 可通过间接寻址读取程序存储器内容
△ 支持在线烧录,擦写次数至少 1000 次
▶ 数据存储器
△ 256 字节 SRAM 通用数据存储器,支持直接寻址、间接寻址等多种寻址方式
△ 64 字节 EEPROM 型数据存储器,支持单独烧录和软件读写, 擦写次数至少 10000 次
▶ 3 组共 18 个 I/O
△ P0(P00~P07), P1(P10~P17), P2(P20~P21)
△ P00/P02 复用成 SCL/SDA 时为开漏输出
△ P1、 P2 为大电流端口
△ 所有端口均支持推挽输出,均内置输入上/下拉电阻且可单独使能/禁用
▶ 时钟系统
△ 内置高频 RC 振荡器(16MHz),可用作系统高频时钟源
△ 内置低频 RC 振荡器(32KHz),可用作系统低频时钟源
▶ 多种系统工作模式
△ 高速模式: CPU 在高频时钟下运行,低频时钟源工作
△ 低速模式: CPU 在低频时钟下运行,高频时钟源可选停止或工作
△ HOLD 模式 1: CPU 停止运行,高频时钟源工作
△ HOLD 模式 2: CPU 停止运行,高频时钟源停止工作,低频时钟源工作
△ 休眠模式: CPU 停止运行,所有时钟源停止工作
▶ 内部自振式看门狗计数器(WDT)
△ 溢出时间可配置: 64ms/2048ms
△ 工作模式可配置:始终开启、始终关闭、低功耗模式下停止
▶ 4 个定时器
△ 8 位定时器 T0,可实现外部计数功能
△ 8 位定时器 T1,可实现比较器 CP0 输出下降沿计数功能
△ 8 位定时器 T2,可实现内/外部计数和高/低电平脉宽测量功能
△ 8 位定时器 T3, 支持 PPG 模式(即支持单次定时且开启时禁止 PPG 重触发)
▶ 1 个 10 位脉冲发生器 PPG
△ 支持端口 PTRIG 输入电平下降沿、或比较器 CP0 输出的下降沿触发 PPG 计数;支持比较器 CP2 输出下降沿停止 PPG 计数;可通过寄存器控制位直接启动或停止 PPG 计数
△ 支持防重触发功能,支持触发去抖和触发延时功能并产生触发中断
△ PPG 输出有效时端口电平高/低可选,输出无效时端口为高阻态
△ PPG 时钟为 FHIRC 的 1/2/4/8 分频, PPG 分辨率最高可达 0.0625us
▶ 1 个 12 位高精度 ADC
△ 12 路外部通道: AN0~AN11; 2 路内部通道: GND、 VDD/4
△ 参考电压可选: VDD、内部参考电压 VIR(4V)
△ ADC 时钟: FHIRC 的 8/16/32/64/128/256/512/1024 分频
△ 支持零点校准或外部输入校准
▶ 4 个比较器
△ 输入共模 0V ~(VDD-1.4),支持正/负输入端偏移自消除模式(调校精度为±2mV)
△ 比较器 CP0: 正/负输入端外接,输出下降沿可触发 PPG
△ 比较器 CP1, 正端 16 级基准电压: 0.34VDD~0.64VDD/0.0625VIR~0.875VIR,分压精度 1%
△ 比较器 CP2, 正端 8 级基准电压: 0.05VDD~0.70VDD/0.425VIR~0.8VIR,分压精度 1%
△ 比较器 CP3, 正端 32 级基准电压: 0.08VDD~0.70VDD/0.1VIR~0.875VIR,分压精度 1%
▶ 1 个运算放大器 OPA
△ 开环放大倍数 60dB
△ 输入共模 0V ~(VDD-1.4),支持正/负输入端偏移自消除模式(调校精度为±2mV)
△ 内置组合电路,支持输出端作为 ADC 输入或比较器 CP3 负端输入
▶ 1 组 IIC 通讯接口
△ 支持 7 位地址编码的从机模式
△ 通讯速率最高支持 400Kbps
▶ 中断
△ 外部中断(INT0~INT1)
△ 定时器中断(T0~T3), ADC 中断, PPG 触发中断(PTRIG/CP0), 比较器中断(CP1~CP3),LVD 中断
△ IIC 通讯中断
▶ 低电压复位 LVR: 2.3V/2.7V/3.3V/4.1V
▶ 低电压检测 LVD: 3.3V/4.2V
▶ 工作电压
△ VLVR27 ~ 5.5V @ Fcpu = 0~8MHz
△ VLVR23 ~ 5.5V @ Fcpu = 0~4MHz
△ VLVR23 ~ 5.5V @ Fcpu = 0~32KHz/2
▶ 封装形式
△ DIP20/SOP16/DIP16